专题
实验报告与可复现证据
电路、仪器、Vivado、仿真脚本和报告材料的整理记录。
波形 参数 报告
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三步读完这个专题
实验 GitLaughs/analog-circuit-labs
模拟电路实验也该整理成可复现实验仓库 2026-05-29
把实验笔记、HSPICE/LTspice 网表、仿真结果和报告素材放在一起,课程结束后仍可查阅。
1529 字
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8 分钟
实验 analogexp/report-workflow
写模拟电路实验报告前,我把材料理了一遍 2026-05-29
网表、波形和调参记录整理好以后,再写 DOCX 会省事很多,后面改报告时也不容易前后打架。
1809 字
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9 分钟
实验 analogexp/simulation-troubleshooting
仿真跑不出来时,我现在会查工具链 2026-05-29
HSPICE、LTspice 没结果,不一定是电路错了。我会看许可证、日志、网表和分析类型。
1344 字
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7 分钟
课程 digital-ic-layout-course/local-report-evidence
数字 IC 版图作业最后别只剩截图 2026-05-29
这次我把原理图、版图、DRC、LVS、RCX 和报告材料按顺序排好,后面补报告时少了很多回忆成本。
1474 字
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7 分钟
实验 analogexp/state-variable-filter
重画 LTspice 状态变量滤波器原理图 2026-05-29
状态变量滤波器已经跑通以后,我又把 LTspice 电路重新排版,并核对拓扑、测量指令和网表结果。
1651 字
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8 分钟
课程 GitLaughs/Verilogexp
写 Verilog 数字钟时,我把模块拆开了 2026-05-29
24 小时计时、数码管扫描、校时、整点报时和跑表都塞进顶层 always,后面会很难改。
1730 字
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9 分钟
实验 analog-lab-prelab-materials
拆实验指导书时,我把预习和实测分开写 2026-05-29
整理模拟电子实验 5-9 时,页码、来源、预习理论和实测结果不能混在一起,不然报告很容易前后矛盾。
1873 字
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9 分钟
实验 windows-bot-memory/simulation-bridge
聊天里跑仿真:把请求收敛为本地任务包 2026-05-29
仿真请求变成任务包后,再交给固定 runner。跑完只列成果,确认后再回传,避免一句话变成本机命令。
1872 字
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9 分钟
实验 analogexp/state-variable-filter
状态变量滤波器实验:我差点把峰值当成通带增益 2026-05-29
这次整理状态变量滤波器报告时,我发现 HP/LP 的通带增益和 BP 的中心峰值不能混着读,尤其是 Q=10 时,10 kHz 附近的峰值很容易误导判断。
1050 字
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5 分钟
课程 GitLaughs/Verilogexp
数字系统实验多了以后,顶层最容易乱 2026-05-29
Verilog 综合实验里,模块单独能跑还不够。顶层选择、板卡资源复用和报告材料也得重新梳理。
2182 字
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11 分钟
课程 GitLaughs/Verilogexp
数字系统实验报告最好能回到源码和波形 2026-05-29
整理 Verilog 数字系统实验时,源码、Vivado 工程、仿真脚本、波形图和报告应放在一起,便于日后复查。
1186 字
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6 分钟
课程 GitLaughs/Verilogexp
Vivado 仿真的终端化流程:先跑脚本再看 GUI 2026-05-29
做数字系统实验时,在 VSCode 终端里固定 top、源码列表、Tcl 和输出目录,再打开 Vivado GUI 看波形。
1338 字
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7 分钟
数字实验波形跑通以后,还要能放进报告
2026-05-29
这次数字系统实验整理给我的提醒:Vivado/xsim 跑完以后,还得把波形整理成信号清楚、比例合适、能放进报告说明结论的图片。
1173 字
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6 分钟
实验 GitLaughs/waveforms-lab-toolkit
实验仪器脚本化以后,dry-run 反而最重要 2026-05-29
看 waveforms-lab-toolkit 时,我最喜欢的是它默认先停住,让我看清计划再碰硬件。
1829 字
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9 分钟
实验 GitLaughs/waveforms-lab-toolkit
给实验报告多留一份 WaveForms 工程 2026-05-29
将 MOS 放大器实验的 CSV、导入脚本、预览图、WaveForms preset 和一键入口打包进同一个 open-box 包,便于日后重新打开复查。
1441 字
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7 分钟
实验 analogexp/exp3_wien_bridge_oscillator
文氏桥振荡器调参,别把不收敛当成电路失败 2026-05-29
调文氏桥振荡器仿真时,模型收敛、频率电阻和稳幅网络要分开判断。先让仿真稳定跑起来,再谈频率误差和幅度限制。
1436 字
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7 分钟